Search academic texts

Information × Registration Number 0419U000305, Candidate dissertation Status Кандидат технічних наук Date 24-01-2019 popup.evolution o Title Methods to reduce hardware costs for combined finite state machine on programmable logic chips Author Grushko Svitlana Serhiivna, popup.head Zeleniova Iryna Iakivna popup.opponent Zascholkin Kostiantin Vyacheslavovich popup.opponent Musienko Maxim Pavlovych Description Дисертаційна робота присвячена вирішенню актуальної наукової задачі розробки структур і вдосконаленню методів синтезу суміщеного МПА, орієнтованих на зменшення апаратурних витрат при реалізації логічної схеми СМПА базисі ПЛІС (FPGA і CPLD). В роботі розроблено структуру СМПА для реалізації в базисі FPGA, що базується на використанні гетерогенної структури FPGA, вдосконалені методи синтезу схем СМПА на FPGA, що дозволяють ефективно використовувати особливості базису гетерогенних FPGA для зменшення апаратурних витрат в логічній схемі СМПА. Розроблено структури і вдосконалено методи синтезу схем СМПА на CPLD. Показано що використання цих структур забезпечує зменшення апаратурних витрат у логічній схемі СМПА в середньому на 29,6 %. Вирішена науково-практична задача мінімізації апаратурних витрат в схемі блоку управління конфігурацією бортовим обчислювальним комплексом. Розроблені рекомендацій щодо використання запропонованих структур і методів для елементної бази різних виробників. Registration Date 2019-01-24 popup.nrat_date 2020-04-03 Close